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6-Lagen-Leiterplatte
6-Lagen-Leiterplatten: Fertigung, Bestückung, Lagenaufbau und Spezifikationen
6-Lagen-Leiterplatten für die Serienfertigung mit veröffentlichter Impedanztoleranz, vollständiger Rückverfolgbarkeit der Innenlagen und schlüsselfertiger Leiterplattenbestückung aus einer Hand, gefertigt nach IPC-6012 Klasse 2 und Klasse 3.
- 6-Lagen-Leiterplatte
- IATF 16949
- IPC-Klasse 2 und 3
- 16+ Jahre
- Kapazität: 500.000 m²/Jahr
- Keine Mindestbestellmenge
Spezifikationen
- 1–40+ Lagenzahl (6 Lagen als Kernkonfiguration)
- 0,20–6,0 mm Leiterplattendicke (Standard: 1,6 mm)
- 3 mil Min. Leiterbahnbreite / Leiterbahnabstand
- 0,15 mm Min. mechanische Durchkontaktierung (6 mil)
- ±10 % / ±5 % Impedanztoleranz
- ENIG·HASL·OSP Oberflächenfinishs
- 48–72 h Vorlaufzeit für Prototypen
- Keine Mindestbestellmenge
Von den Grenzen einer 4-Lagen-Leiterplatte zur serienreifen 6-Lagen-Leiterplatte
Eine 6-Lagen-Leiterplatte ordnet vier Signallagen um zwei separate Versorgungs- und Masseflächen an und bietet schnellen Leiterbahnen damit eine durchgehende Referenzfläche, die eine 4-Lagen-Leiterplatte nicht bieten kann. Allein diese Änderung reduziert elektromagnetische Störungen (EMI), verbessert die kontrollierte Impedanz und schafft Verdrahtungskanäle für das dichte Fanout von BGA und FPGA.
Sechs Lagen werden sinnvoll, wenn bei einem 4-Lagen-Design der Platz ausgeht: durch aufgeteilte Flächen, Übersprechen zwischen benachbarten Signallagen oder einen fehlenden durchgehenden Rückstrompfad unter einem Bus mit 100 MHz+. Der Grund ist physikalisch: Zwei Lagen reichen nicht gleichzeitig für durchgehende Referenzflächen und die Signaldichte, die ein moderner Prozessor benötigt.
Mehr Lagen sind allerdings nicht automatisch besser. Eine oft wiederholte technische Mahnung bringt es auf den Punkt: Zusätzliche Lagen führen „nicht immer“ zu einer besseren Leiterplatte; richtig ist die Lagenzahl, die jedem kritischen Netz zu den niedrigsten stabilen Kosten eine Referenzfläche bietet. PCBark betrachtet 6 Lagen als zweckgerechten Schritt und prüft sie anhand von Fertigungsstandards wie den Verarbeitungsanforderungen der NASA-STD-8739.3 für elektronische Hardware.
Entscheidungshilfe: 4 → 6 → 8 Lagen
| Auslöser in Ihrem Design | 4 Lagen | 6 Lagen | 8 Lagen |
|---|---|---|---|
| Eine einzelne Versorgungsspannung ohne geteilte Fläche | Ausreichend | Reserven | Überdimensioniert |
| 2–3 Versorgungsspannungen + 1 Hochgeschwindigkeitsbus | Flächenkonflikt | Passende Lösung | Reserven |
| Kontrollierte Impedanz + EMI-Reserve | Grenzwertig | Solide (2 GND-Referenzen) | Solide |
| Fanout dichter BGA-Gehäuse (Rastermaß ≥0,5 mm) | Durch Mikrodurchkontaktierungen begrenzt | HDI-geeignet | Beste Verdrahtungsmöglichkeiten |
| HF-Frontend + Trennung von Analog- und Digitalsignalen | Schwierig | Machbar | Machbar |
Lagenaufbau und kontrollierte Impedanz bei 6-Lagen-Leiterplatten
Zwei Konfigurationen decken die meisten 6-Lagen-Anwendungen ab. Beim Standardaufbau SIG / GND / SIG / PWR / GND / SIG liegen die Verdrahtungslagen zwischen durchgehenden Flächen, was die beste EMI-Kontrolle ermöglicht; die auf hohe Verdrahtungsdichte ausgelegte Variante SIG / GND / SIG / SIG / GND / SIG tauscht eine Referenzfläche gegen zwei benachbarte innere Signallagen.
Der Lagenaufbau rechtfertigt die Kosten einer 6-Lagen-Leiterplatte. Signalprobleme sind hier real: Führt man ein differenzielles Leiterbahnpaar mit 90 Ω über eine geteilte Fläche, entstehen Reflexionen und Laufzeitunterschiede, und die Konformitätsprüfung kann scheitern. Ursache ist der unterbrochene Rückstrompfad; Abhilfe schafft ein symmetrischer Lagenaufbau, der jede schnelle Leiterbahn eng an eine durchgehende Kupferreferenz koppelt.
| PRIORITÄT | EMPFOHLENER 6-LAGEN-AUFBAU | REFERENZ / IMPEDANZ | TYPISCHER EINSATZ |
|---|---|---|---|
| Beste Signalintegrität / EMI-Kontrolle | SIG / GND / SIG / PWR / GND / SIG | L1 und L6 als Mikrostreifenleitung, L3 als Streifenleitung — 50 Ω / 100 Ω | Schnelle Digitalschaltungen, ADAS, BMS |
| Maximale Verdrahtungsdichte | SIG / GND / SIG / SIG / GND / SIG | 2 innere Verdrahtungslagen, durch einen dicken Kern getrennt | Fanout dichter BGA-Gehäuse |
| Trennung von HF- und Mischsignalen | SIG / GND / PWR / GND / SIG / GND | Separater GND-Abschirmbereich unter dem HF-Teil | 5G-Frontend, Sensoren |
| Begrenzte Bauhöhe (Wearable) | Symmetrischer Aufbau mit 1,0 mm | Dünnes Prepreg, ±5 % Impedanztoleranz | Medizinisches Wearable mit HDI |
Technischer Hinweis: nachprüfbare Impedanz
Technischer Hinweis: nachprüfbare Impedanz
PCBark fertigt standardmäßig mit einer veröffentlichten Impedanztoleranz von ±10 % und auf Anfrage mit ±5 %. Bei Aufträgen mit kontrollierter Impedanz liegt ein TDR-Bericht (Zeitbereichsreflektometrie) zum vorgegebenen Zielwert bei. Symmetrie ist entscheidend: Ein mittiger Kern mit auf beiden Seiten abgestimmten Prepregs und Kupferfolien verhindert den Verzug, der bei asymmetrischen 6-Lagen-Aufbauten während der Verpressung entsteht.
Die fertige Standarddicke beträgt 1,6 mm (62 mil); für Anwendungen mit begrenztem Bauraum oder Backplanes bieten wir auch Aufbauten mit 0,8, 1,0, 1,2 und 2,0 mm an. Das entspricht dem von Entwicklern erwarteten Dickenbereich für 6-Lagen-Leiterplatten; die Toleranz beträgt ±10 %. Die differenzielle De-Embedding-Messung folgt Methoden aus IEEE 370, und dualpolarisierte Millimeterwellenstrukturen auf HTML mit sechs Lagen sind inzwischen in veröffentlichten Patentanmeldungen wie WO 2023/165634 A1 dokumentiert.
Technischer Hinweis: Designregeln für den 6-Lagen-Aufbau
Technischer Hinweis: Designregeln für den 6-Lagen-Aufbau
Bei einer 6-Lagen-Leiterplatte bestimmt die Dicke des Dielektrikums zwischen jeder Signallage und ihrer Referenzfläche, welche Leiterbahnbreite für die gewünschte Impedanz nötig ist. Halten Sie das Prepreg zwischen L1 und der Massefläche auf L2 dünn, damit ein schnelles Signal mit kontrollierter Impedanz eng gekoppelt bleibt, und führen Sie Lage 3 als Streifenleitung zwischen der inneren Massefläche und der Versorgungsfläche aus.
Die Kapazität zwischen Versorgungs- und Massefläche sorgt für eine natürliche Entkopplung, senkt EMI und unterstützt die Einhaltung der EMV-Anforderungen. Halten Sie den Aufbau um den mittleren Kern symmetrisch, um die Impedanz einzuhalten und Verzug zu vermeiden, und führen Sie schnelle Signale nie über eine Trennstelle in der Referenzfläche. Ein Beispiel für einen standardmäßigen 6-Lagen-Aufbau hat eine Dicke von 1,6 mm. Wir übernehmen auch Lagenaufbau- und Designregeldateien aus gängigen Leiterplattendesign-Werkzeugen, sodass sich Ihr anspruchsvolles Leiterplattendesign problemlos in unseren Entwicklungsablauf für 6-Lagen-Leiterplatten einfügt. Prüfen Sie vor der Fertigungsfreigabe die Designregeln für Signal- und Versorgungsnetze in Ihrem Leiterplattenlayout: Die Kombination aus Versorgungs- und Massefläche hält jeden Signalrückstrompfad durchgehend und wahrt die Signalintegrität, ohne die EMI-Reserve zu beeinträchtigen.
• ZUM AUSRICHTEN MAUSZEIGER ÜBER BAUTEIL BEWEGEN •
Serienfertigung im Vergleich zu günstigen Prototypenherstellern: Wo der Unterschied sichtbar wird
Ehrlich gesagt: Hier geht es nicht um „Wir sind günstiger“. Ein Prototyp für $2 in 48 Stunden und eine rückverfolgbare Serienversorgung sind zwei verschiedene Aufgaben; der beworbene Preis gilt nur für Leiterplatten unter 50 × 50 mm. Die Probleme zeigen sich später: eine ungeprüfte Innenlage oder ein Impedanzwert, den niemand schriftlich zusichern will.
Die Kosten über den Lebenszyklus entsprechen der verbreiteten Einschätzung aus der Praxis, dass die anfangs billigste Leiterplatte selten die insgesamt günstigste Entscheidung ist. Ein durch eine ausgefallene Innenlage erzwungenes Redesign der 6-Lagen-Leiterplatte oder eine neue 8-Lagen-Auslegung wegen mangelhafter Impedanzkontrolle kostet weit mehr als der Preisunterschied pro Leiterplatte; dieser Zielkonflikt wird in der bei IEEE Xplore erfassten Fachliteratur zur Signalintegrität behandelt.
+30–40%
Typischer Kostensprung von 4 auf 6 Lagen – der Punkt, an dem die korrekte Auslegung und der Impedanznachweis statt des Stückpreises die Gesamtkosten bestimmen.
Quelle: Preiszusammensetzung für Leiterplatten von Sierra Circuits.
Vergleich der entscheidenden Spezifikationen
| [Entscheidungsfaktor] | Günstiger Prototypenhersteller | PCBark Serienfertigung und EMS |
|---|---|---|
| Zugesicherte Impedanz | „Ja“, aber ohne veröffentlichte ±-Toleranz | ±10 % / ±5 % + TDR-Bericht |
| Nachweis für Innenlagen | Nur elektrische Prüfung mit Bestanden/Nicht bestanden | 100 % elektrische Prüfung + Mikroschliff + Röntgenprüfung |
| Nachweis für die Automobilindustrie | Nicht angegeben | IATF 16949 + IPC-6012FA |
| Bestückung | Unbestückte Leiterplatte oder separate Bestückung | Schlüsselfertige SMT-/BGA-/THT-Bestückung + Beschaffung |
| Rückverfolgbarkeit | Auf Chargenebene | Serialisiert + Datenarchiv für ≥5 Jahre |
| Mengenmodell | Preisstaffeln für Prototypen | Keine Mindestbestellmenge + Staffelpreise für die Serienfertigung |
Zertifizierungen und Qualitätssicherung der Innenlagen
Vertrauen in eine 6-Lagen-Leiterplatte entsteht durch die Lagen, die Sie nicht sehen können. Behauptet ein Lieferant, zertifiziert zu sein, kann beim Audit aber keine Nachweise vorlegen, setzen wir dem benannte Normen und dokumentierte Prüfdaten entgegen statt bloßer Adjektive.
- IATF 16949 Qualitätsmanagementsystem für die Automobilindustrie
- ISO 9001:2015 Qualitätsmanagementsystem
- ISO 14001 Umweltmanagement
- UL Gelistet
- IPC-Klasse 2/3 Verarbeitungsqualität
- RoHS / REACH Konformität
KONTINUIERLICHE PRÜFANZEIGE: AOI-SCANMODUS
Jeder Auftrag für 6-Lagen-Leiterplatten durchläuft eine 100 % elektrische Prüfung, eine automatisierte optische Inspektion jedes Innenlagenkerns, eine Röntgenprüfung der BGA-Lötstellen und eine Querschliffanalyse von Kupferdicke und Galvanisierung. Die Abnahme folgt einer durch ISO 14001 gestützten Prozesskontrolle und den visuellen Kriterien der IPC-A-600; die Ergebnisse werden je Charge archiviert.
Stattdessen erhalten Sie greifbare Nachweise: ein Querschliffbild Ihres inneren Kupfers, das Ergebnis der Flying-Probe-Netzlistenprüfung und die TDR-Messkurve der Impedanz, mindestens fünf Jahre lang unter Ihrer Chargennummer archiviert. Ein günstiger Leiterplattenhersteller, der nur „Bestanden“ oder „Nicht bestanden“ meldet, kann Ihnen die Innenlagen nicht zeigen; wir dokumentieren sie und machen so aus „Vertrauen Sie uns“ einen Nachweis.
Einkaufsleitfaden: Kostenfaktoren, Vorlaufzeiten und Bestellung von 6-Lagen-Leiterplatten
Das Problem für Einkäufer ist hier das Lockangebot: ein niedriger Ausgangspreis, der sich ändert, sobald ein „individueller“ Lagenaufbau oder eine realistische Größe ins Spiel kommt. Deshalb nennen wir statt einer einzelnen Zahl die Kostenfaktoren, damit Sie vor der Bestellung abschätzen können, wodurch sich die Kosten Ihrer 6-Lagen-Leiterplatte verändern.
Hinter einem Angebot steht reale Kapazität, und sie sichert Ihre Vorlaufzeit. Als Hersteller von 6-Lagen-Leiterplatten mit Fertigung und schlüsselfertiger Bestückung bei einer Kapazität von 500.000 m²/Jahr sowie LDI-Belichtung, Inline-AOI, Röntgenprüfung und Flying-Probe-Test verhindern wir, dass ein Serienauftrag hinter Prototypen in der Warteschlange stecken bleibt – versteckte Kosten, die günstige Anbieter selten erwähnen. Bei den Kosten nennen wir die Abwägung von Anfang an, statt sie in einer geänderten Rechnung zu verstecken.
[CAM.1] 3:2 MAKRO
Kostenfaktoren bei 6-Lagen-Leiterplatten
Lagenschritt: Der Wechsel von 4→6 Lagen erhöht die Leiterplattenkosten um etwa 30–40 % (Sierra Circuits)
Leiterplattengröße und Nutzenbelegung – der eigentliche Grund für die Grenzen „günstiger“ Prototypen
Kupfergewicht und kontrollierte Impedanz (TDR bedeutet zusätzliche Prüfung statt Schätzung)
Basismaterial: FR-4 gegenüber High-Tg gegenüber Rogers/PTFE für HF
Oberflächenfinish: ENIG und ENEPIG kosten mehr als HASL/OSP
Menge: keine Mindestbestellmenge für Prototypen, Staffelpreise bis zur Serienfertigung
Stufen vom Prototyp bis zur Serienreife
| Phase | Vorlaufzeit | Ihre Unterlagen |
|---|---|---|
| Prototyp | 48–72 h | Gerber-Daten + Lagenaufbau + Impedanzzielwert |
| Kleinserie / Inbetriebnahme | ~1 Woche | Gerber-Daten + Stückliste (für die Bestückung) |
| Serienfertigung | Gestaffelter Zeitplan | Bedarfsprognose + freigegebenes Erstmuster |
Bestellung in vier Schritten
Laden Sie Ihre Gerber-Daten für ein Angebot hoch, erhalten Sie eine kostenlose DFM-Analyse, geben Sie das Erstmuster frei und starten Sie anschließend die Serienfertigung – mit demselben technischen Ansprechpartner für alle Schritte. Benötigen Sie einen Preis für Ihre genaue Größe und Klasse?
Fordern Sie ein Angebot anund wir kalkulieren Ihren konkreten 6-Lagen-Aufbau. Unsere Hinweise zur fertigungsgerechten Konstruktion orientieren sich an öffentlich zugänglichen Referenzen wie den Verarbeitungsanforderungen der NASA-STD-8739.4.
Entwicklungswerkzeuge für 6-Lagen-Leiterplatten
Lagenaufbau-Konfigurator
Konfigurieren Sie die optimale Dielektrikumsdicke, Prepreg-Typen und Impedanzprofile für die Fertigung mit 6 Lagen.
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Lagenempfehlung
Analysieren Sie die Verdrahtungsdichte der Signale, um die ideale Verteilung von Masse-, Versorgungs- und Signallagen zu bestimmen.
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Kostenrechner
Berechnen Sie die aktuellen Fertigungskosten anhand von Basismaterialien, Oberflächenfinishs und Mengenanforderungen.
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DFM-Checkliste
Prüfen Sie Gerber-Dateien anhand der Fertigungsgrenzen für 6 Lagen (Leiterbahnbreite/Leiterbahnabstand, Bohrungsgrößen), um Verzögerungen zu vermeiden.
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01
Wie viel mehr kostet eine 6-Lagen-Leiterplatte gegenüber einer 4-Lagen-Leiterplatte?
Der Wechsel von 4 auf 6 Lagen erhöht die Leiterplattenkosten laut den Preisdaten von Sierra Circuits um etwa 30–40 %. Die zusätzlichen Lagen schaffen zwei durchgehende Referenzflächen und mehr Platz für die Verdrahtung – meist günstiger als eine später nötige Neuauslegung mit 8 Lagen, wenn das 4-Lagen-Design zu eng wird.
02
Ist der Preis von $2 für eine 6-Lagen-Leiterplatte in 48 Stunden realistisch?
Dieser beworbene Preis gilt nur für kleine Prototypen unter etwa 50 × 50 mm, worauf erfahrene Einkäufer in Foren häufig hinweisen. Bei einer realistischen Größe, kontrollierter Impedanz oder Bestückung fordern Sie ein Angebot auf Basis Ihrer tatsächlichen Gerber-Daten an , damit der Preis Ihre Leiterplatte widerspiegelt und kein Lockangebot ist.
03
Garantieren Sie bei 6-Lagen-Leiterplatten eine kontrollierte Impedanz?
Ja, wir fertigen standardmäßig mit ±10 % Impedanztoleranz und auf Anfrage mit ±5 %; dazu liefern wir einen TDR-Bericht zum vorgegebenen Zielwert. Entwickler auf EEVblog weisen darauf hin, dass manche günstigen Hersteller „kontrollierte Impedanz“ angeben, ohne eine Toleranz zu veröffentlichen; wir veröffentlichen unsere.
04
Gibt es für 6-Lagen-Leiterplatten eine Mindestbestellmenge?
Nein – überhaupt keine. Wir fertigen Prototypen mit 6 Lagen ohne Mindestbestellmenge und bieten bei steigenden Stückzahlen Staffelpreise.
05
Wie sehen der Standardlagenaufbau und die Standarddicke einer 6-Lagen-Leiterplatte aus?
Ein gängiger Aufbau ist SIG/GND/SIG/PWR/GND/SIG mit einer fertigen Dicke von 1,6 mm. Für Designs mit begrenztem Bauraum oder für Backplanes fertigen wir auch symmetrische Aufbauten mit 0,8, 1,0, 1,2 und 2,0 mm.
06
Wann sollte ich von einer 4-Lagen- auf eine 6-Lagen-Leiterplatte umsteigen?
Steigen Sie um, wenn ein 4-Lagen-Design nicht mehr jedem schnellen Netz eine durchgehende Referenzfläche bieten kann, wenn Sie zwei oder mehr getrennte Versorgungsspannungen benötigen oder wenn für das Fanout dichter BGA-Gehäuse und die EMI-Reserve der Platz ausgeht.
07
Ist eine 8-Lagen-Leiterplatte besser als eine mit 6 Lagen? (6-Lagen-Leiterplatte vs. 8 Lagen)
Nicht grundsätzlich; mehr Lagen sind nicht immer besser. Bleiben Sie bei 6 Lagen, wenn jedes schnelle Netz bereits eine durchgehende Referenzfläche hat und Ihre Versorgungsspannungen auf zwei Versorgungs-/Masseflächen Platz finden; wechseln Sie erst bei entsprechend hoher Verdrahtungsdichte oder wenn zusätzliche Flächenpaare nötig sind, auf 8 Lagen. Wir bieten beide Varianten an, damit die Lagenzahl Ihrem Design folgt und nicht einer Gewohnheit.
08
Wie schnell kann ich einen Prototyp einer 6-Lagen-Leiterplatte erhalten?
Die Vorlaufzeit für unsere Prototypen mit 6 Lagen beträgt 48–72 Stunden, ohne Mindestbestellmenge. Senden Sie uns Gerber-Daten und den Lagenaufbau mit Ihrem Impedanzzielwert; noch am selben Tag erhalten Sie ein Angebot für die Fertigung Ihrer 6-Lagen-Leiterplatte samt kostenloser DFM-Analyse.
09
Welche Materialien und Oberflächenfinishs bieten Sie für 6-Lagen-Leiterplatten an?
FR-4 Tg150/170, Rogers, PTFE, Polyimid sowie Keramik- und Metallkernsubstrate, mit ENIG, HASL, OSP, chemisch abgeschiedenem Silber/Zinn, ENEPIG und Goldfingern. Wir stimmen das Material auf Ihre Vorgaben für Impedanz, Wärmemanagement und Frequenz ab.
