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HDI TOUTES COUCHES · LAMINATION SÉQUENTIELLE
Fabrication de circuits imprimés HDI toutes couches — lamination séquentielle et microvias remplis de cuivre
Si vous ne parvenez plus à répartir les connexions de votre BGA à pas fin sur un HDI 1+N+1, le problème vient du routage, pas de l’implantation. PCBark propose le HDI toutes couches, où chaque couche permet l’interconnexion, afin de tout faire tenir dans l’encombrement prévu pour votre produit à expédier.
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Caractéristiques techniques
Toutes couches / ELIC
Interconnexion sur chaque couche, ainsi que de 1+N+1 à 3+N+3
~100 µm
Microvia rempli de cuivre, rapport d’aspect de 0,75:1
75 µm
Largeur des pistes / espacement atteignables sur les fabrications avancées
Classe 3
Fabrication et contrôle conformes à la classe 3 d’IPC-6012
30–40%
Réduction habituelle de la surface du circuit imprimé par rapport à une construction classique
16+ ans
Expérience en services de fabrication électronique, capacité de 500 000 m²/an
Avantage technique
Quand le HDI 1+N+1 classique manque de place pour le routage
Vous connaissez la situation. L’implantation et le schéma conviennent, mais les connexions du BGA le plus dense ne peuvent pas être dégagées. Il n’y a plus de passages pour les vias entre les billes, et la seule solution qui se présente est d’augmenter le nombre de couches ; le circuit imprimé devient plus épais et plus grand. C’est là que le HDI atteint sa limite.
Avec une structure ELIC, en revanche, cette limite disparaît. Sur un circuit imprimé multicouche classique, les connexions passent par des microvias en surface et par des vias enterrés dans l’âme de l’empilement des couches, mais le reste du routage doit emprunter les trous métallisés traversants du circuit. Un circuit imprimé à empilement toutes couches supprime cette contrainte : au lieu de limiter les connexions par vias borgnes aux couches ajoutées sur une âme à trous traversants, chaque couche diélectrique possède ses propres microvias percés au laser et remplis de cuivre.
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Chacune de ces couches peut ainsi être reliée à toute couche adjacente. Si l’empilement ELIC intègre des microvias empilés, les connexions peuvent alors être prolongées jusqu’à la couche la plus haute du circuit. C’est ainsi que nous avons pu router une puce au pas de 0,4 mm sur des circuits d’essai, alors qu’une construction équivalente, même en 2+N+2, ne permettait pas d’achever le routage.
L’utilisateur final obtient un format réduit et une densité accrue. Aucune couche n’étant « interdite », les pistes peuvent passer sur la couche 2 d’une structure toutes couches à 10 couches comme elles le feraient dans une conception classique à 14 couches ; les concepteurs peuvent réduire le nombre total de couches tout en conservant le même nombre de connexions ; ils peuvent aussi diminuer la surface totale du circuit imprimé jusqu’à 40 % par rapport à une construction classique.
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Ce gain de place a un prix : la complexité de fabrication. La technologie toutes couches utilise des laminations séquentielles et, selon une source proche de cette technologie, le HDI toutes couches reste considéré comme une technologie avancée, non standard, que la plupart des fabricants de circuits imprimés ne proposent pas facilement. PCBark dispose de cette capacité.
01 / Capacités
Capacités HDI toutes couches de PCBark — empilements et structures
La plupart des circuits HDI ne nécessitent pas une structure toutes couches, et une page de présentation honnête doit vous indiquer la solution HDI adaptée à l’application ; en général, nous recherchons le circuit imprimé le moins coûteux dont le routage reste réalisable. Voici comment associer une structure courante à son domaine d’application ; on ne monte au niveau supérieur que lorsque le précédent n’offre plus assez de canaux de routage.
| Structure | Couches ajoutées à microvias | Routage adapté à | Quand passer au niveau supérieur |
|---|---|---|---|
| 1+N+1 | 1 couche à microvias de chaque côté d’une âme | Un seul BGA dense, pas >0,5 mm, nombre d’entrées/sorties modéré | Canaux de sortie des connexions trop étroits sur un composant électronique |
| 2+N+2 | 2 couches à microvias de chaque côté | BGA au pas de 0,4–0,5 mm, davantage d’entrées/sorties | Composants empilés, plusieurs composants électroniques denses |
| 3+N+3 | 3 couches à microvias de chaque côté | Très grand nombre d’entrées/sorties, circuits imprimés à plusieurs BGA | Canaux pour vias toujours insuffisants, surface limitée |
| Toutes couches (ELIC) | Chaque couche est une couche d’interconnexion | Pas inférieur à 0,4 mm, densité maximale, encombrement minimal | C’est le niveau maximal : liberté totale de routage |
02 / Plage de capacités
Plage de capacités techniques
Les circuits imprimés toutes couches reposent sur des microvias d’environ 100 µm, remplis de cuivre, avec un rapport d’aspect de 0,75:1 — le seul rapport permis par notre plage de métallisation et la valeur de référence donnée par IPC-2226 pour sa « cible fiable », plutôt que son maximum plus généreux de 1:1 —, ainsi que sur des géométries à pistes et espacements fins jusqu’à 75 µm de largeur de piste et d’espacement dans nos constructions avancées. Le diamètre réel des microvias achevés est de 75–150 µm sur les circuits standard, et peut être encore inférieur sur les fabrications spécialisées.
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Les microvias sont réalisés par perçage laser à travers les couches, puis métallisés et remplis de cuivre afin que la pastille de connexion de la couche suivante repose à plat. L’alignement entre les couches est le principal facteur de coût du toutes couches — ou plutôt son principal risque. Chaque cycle de lamination présente un risque de déplacement de l’empilement ; nous travaillons donc avec nos clients pour maîtriser l’écoulement du préimprégné pendant ces cycles. La réduction de la longueur des pistes, rendue possible par des géométries plus serrées, améliore également l’intégrité du signal en plus d’accroître la densité : c’est l’autre volet de la miniaturisation. Voilà comment notre équipe aborde la fabrication de circuits toutes couches ; les performances atteignables pour votre projet dépendent de l’épaisseur de cuivre, du diélectrique et du nombre de couches, paramètres définis avec nos ingénieurs DFM avant la préparation des outillages de production.
| Paramètre | Capacité | Référence |
|---|---|---|
| Structures d’interconnexion | 1+N+1, 2+N+2, 3+N+3, toutes couches / ELIC | Niveaux de conception IPC-2226 |
| Microvia | Rempli de cuivre, ~100 µm, rapport d’aspect de 0,75:1 | IPC-2226 / IPC-6016 |
| Largeur des pistes / espacement | Jusqu’à ~75 µm sur les fabrications avancées | À confirmer lors de l’analyse DFM |
| Protection / remplissage des vias | Microvias empilés et décalés remplis de cuivre, vias dans les pastilles | IPC-4761 |
| Classe de fiabilité | Fabrication et contrôle conformes à la classe 3 d’IPC-6012 | IPC-6012 |
| Assemblage de cartes électroniques | Assemblage SMT clé en main, approvisionnement en composants, test fonctionnel | Réalisé en interne par PCBark |
Par rapport à un circuit imprimé à trous traversants, le circuit toutes couches permet des pistes et des espacements plus fins, car ses microvias sont percés au laser plutôt que par le perçage mécanique des vias borgnes et enterrés dont dépend un circuit classique. Le perçage mécanique ne permet pas de placer des trous aussi petits ni aussi rapprochés ; c’est pourquoi la largeur des pistes et leur espacement peuvent diminuer en même temps que la surface du circuit imprimé.
En savoir plus — notes pour l’atelierAfficher moins
Deux remarques pour l’atelier. Nous cherchons à limiter le nombre de laminations séquentielles et de cycles au minimum imposé par la complexité de votre fabrication : chaque cycle supplémentaire ajoute des opérations de pressage, de perçage, de métallisation et de photogravure, entre autres ; recommander une structure toutes couches inutilement complexe serait donc une erreur coûteuse de notre part. En plus de gérer ces contraintes, nous aplanissons les microvias placés dans les pastilles sous votre BGA après leur remplissage, afin que le masque de soudure et la pâte à braser reposent uniformément ; si vous cherchez une densité de routage qui complique le placement des composants et l’assemblage de cartes électroniques, libre à vous de le faire. La technologie toutes couches se combine aussi bien avec une conception rigide-flexible lorsque le produit doit se plier ; lorsque l’empilement devient épais, il faut également maîtriser la dilatation thermique selon l’axe Z — notre équipe d’analyse DFM examine ces choix tôt pour éviter une hausse des coûts par la suite.
HDI toutes couches, HDI séquentiel 1+N+1 et trous traversants — les données
Les mentions « élevé », « moyen » et « faible » ont leur place dans une brochure, pas sur un circuit imprimé que vous devez valider. Voici une représentation d’un exemple de conception de circuit selon trois types de construction courants, fondée sur les facteurs qui déterminent réellement votre coût et votre délai de mise sur le marché, plutôt que sur des catégories qui simplifient trop le problème : les possibilités de routage offertes par le circuit, sa taille finale et le coût nécessaire pour y parvenir.
| Paramètre | Multicouche à trous traversants | HDI 1+N+1 | HDI toutes couches |
|---|---|---|---|
| Pas minimal de BGA routable | ~0,8 mm | ~0,5 mm | ≤0,4 mm |
| Type de via d’interconnexion | Trou traversant métallisé | Microvias sur les couches externes + âme à trous traversants métallisés | Microvia rempli de cuivre sur chaque couche |
| Surface relative du circuit imprimé | Référence (100 %) | ~75–85% | ~60–70% |
| Nombre de couches pour la même répartition des connexions | Le plus élevé | Plus faible | Le plus faible |
| Longueur du trajet du signal | La plus longue | Plus courte | La plus courte |
| Cycles de lamination | 1 | 1–2 | 3+ (séquentiels) |
| Coût relatif de fabrication | Le plus faible | Modéré | Le plus élevé, compensé par les gains de surface et de couches |
/// DONNÉES DE COMPARAISON
Le coût en chiffres : la fabrication toutes couches est la plus chère, car la séquence de lamination se répète à chacune des six étapes de lamination séquentielle ; les chiffres montrent qu’un HDI à 6 couches coûte environ 30-50 % de plus qu’un circuit à 4 couches pour cette seule raison.
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Cet indicateur ne tient toutefois pas compte des compromis à l’échelle du système. Vous économisez de l’argent et de la place grâce à un format plus compact, à un nombre réduit de couches nécessaires et à un meilleur rendement de l’assemblage de cartes électroniques lorsque les vias sont placés dans les pastilles des composants concernés plutôt qu’en face de ces pastilles. Pour un produit soumis à de fortes contraintes d’encombrement, un circuit à trous traversants peut sembler moins cher au départ qu’un circuit toutes couches. Mais une fois pris en compte le boîtier, les couches nécessaires et les reprises, il peut finir par vous coûter davantage.
Résultats clients : encombrement, densité d’entrées/sorties et fiabilité des microvias
Le toutes couches se justifie lorsqu’il faut répondre à des exigences de taille, de densité de routage et de fiabilité :
Cas de figure 01
Faire tenir un BGA au pas inférieur à 0,4 mm dans un objet connecté portable
Dans un cas, une équipe qui développait un produit grand public équipé d’un processeur de catégorie smartphone devait implanter des composants au pas de 0,35 millimètre (mm), mais ne parvenait pas à répartir toutes leurs connexions sur les couches de sa structure 2+N+2. En adoptant une fabrication toutes couches, elle a pu répartir les connexions sur l’ensemble du circuit imprimé, faire tenir la conception dans les dimensions imposées et éviter d’ajouter des couches.
≤0,4 mm
Pas de BGA routé
~35%
Réduction de la surface du circuit imprimé
0 ajoutée
Paires de couches par rapport à l’empilement précédent
Cas de figure 02
Résister aux cycles thermiques sans décollement des microvias
Pour fabriquer un module aérospatial soumis, comme un implant destiné à un dispositif médical, à des exigences de fiabilité élevées, l’équipe cherchait à éviter la défaillance des microvias empilés lors d’essais de cyclage thermique poussés et sévères. De nombreux ingénieurs ont du mal à maîtriser la dilatation thermique selon l’axe Z, qui constitue un véritable défi technique. La fabrication de ce circuit imprimé reposait sur des trous remplis de cuivre, un nombre de cycles soigneusement maîtrisé, l’emploi de trous traversants décalés lorsque cela était permis et la protection des vias selon IPC-4761 ; le circuit a également été contrôlé conformément à la classe 3 d’IPC-6012.
Classe 3
Fabrication et contrôle selon IPC-6012
Rempli de Cu
Structure des microvias
IPC-4761
Protection des vias appliquée
Cas de figure 03
Répartir les connexions d’un FPGA à grand nombre de broches
Dans les conceptions FPGA à grand nombre d’entrées/sorties, les structures classiques continuent d’offrir trop peu de possibilités de vias, même une fois l’implantation requise terminée. Les circuits imprimés toutes couches rendent chaque niveau disponible pour répartir les connexions, ce qui permet de préserver les voies de sortie et de faire suivre aux paires à impédance contrôlée le trajet prévu sans obstacle lié à l’emplacement des vias.
Toutes couches
Répartition des connexions sur tout l’empilement
Axe Z
Routage par microvias empilés
Maîtrisée
Paires à impédance contrôlée préservées
Assurance qualité
Certifications et normes de fiabilité
Partenariats collaboratifs
Échanges avec les clients
Commander un circuit HDI toutes couches : choix de l’empilement, délai et analyse DFM
Il n’existe pas de prix unique pour un circuit imprimé toutes couches : celui-ci dépend des choix propres à votre configuration d’empilement. Pour vous aider à commencer à estimer les coûts avec précision, voici les facteurs qui influencent le prix du toutes couches.
Cycles de lamination
C’est le principal facteur de coût. Chaque cycle séquentiel répète le pressage, le perçage, la métallisation et la photogravure. Moins il y a de cycles, moins le coût est élevé — nous déterminons leur nombre selon votre routage, pas selon un catalogue.
Nombre de couches et structure
Le choix entre toutes couches, 2+N+2 et 3+N+3 modifie les matériaux et le procédé. La structure la moins complexe qui permet encore de router votre circuit imprimé est la moins chère à fabriquer.
Géométrie et remplissage des microvias
Le remplissage au cuivre, la planarisation des vias dans les pastilles et les rapports d’aspect plus serrés ajoutent des étapes de fabrication qui influent sur le prix et le rendement.
Matériau et épaisseur de cuivre
Les stratifiés à faibles pertes ou à Tg élevé et le cuivre de plus forte épaisseur modifient à la fois le coût et la largeur de piste ainsi que l’espacement réalisables.
Classe de fiabilité et conformité
La classe 3 d’IPC-6012, les essais supplémentaires et la traçabilité IATF 16949 augmentent le travail de contrôle — et sont indispensables lorsqu’ils s’appliquent.
Volume et calendrier
Les prototypes et les fabrications à délai court n’ont pas les mêmes coûts qu’une production en série. Indiquez-nous la quantité et la date souhaitée.
OUTILS D’INGÉNIERIE INTERACTIFS
Suite d’outils HDI toutes couches
Accédez à nos calculateurs exclusifs pour configurer les empilements des couches, vérifier la conformité à IPC-2226, estimer les indices de coût et préparer des spécifications précises pour vos demandes de devis de fabrication.
OUTIL // 01
Sélecteur de structure HDI
Évaluez le pas des BGA, la densité d’entrées/sorties et les contraintes de surface du circuit imprimé pour déterminer l’architecture de routage la moins coûteuse.
OUTIL // 02
Vérificateur du rapport d’aspect des microvias
Vérifiez les dimensions de vos microvias et l’épaisseur du diélectrique par rapport à la plage de métallisation fiable définie par IPC-2226.
OUTIL // 03
Estimateur de coût et de taille
Comparez le pourcentage de réduction de l’encombrement à la majoration du coût de fabrication pour différents niveaux HDI.
OUTIL // 04
Générateur de spécifications pour devis HDI
Générez un bloc de demande de devis standardisé, prêt pour l’analyse DFM, afin d’obtenir rapidement un prix de fabrication précis.
Ressources techniques
FAQ sur les circuits imprimés HDI toutes couches
Qu’est-ce qu’un circuit imprimé HDI toutes couches, et en quoi diffère-t-il d’un HDI 1+N+1 classique ?
Dans un circuit imprimé HDI toutes couches, chaque couche sert à l’interconnexion grâce à des microvias empilés et remplis de cuivre ; une piste située sur une couche peut donc rejoindre n’importe quelle autre couche. Le HDI 1+N+1 classique ajoute seulement des couches à microvias sur les deux faces externes d’une âme à trous traversants. Le toutes couches supprime cette limite de routage : il est utilisé lorsqu’il est impossible de répartir les connexions d’un BGA dense sur une structure 1+N+1 ou 2+N+2.
Pourquoi le HDI toutes couches coûte-t-il plus cher que le HDI classique ?
Le coût suit le nombre de cycles de lamination séquentielle. Chaque cycle ajouté implique de nouvelles opérations de pressage, de perçage, de métallisation et de photogravure ; un empilement toutes couches coûte donc plus cher qu’un circuit réalisé en une seule séquence de fabrication. Selon les données du secteur, un HDI à 6 couches coûte environ 30-50 % de plus qu’un circuit à 4 couches. La contrepartie est réelle : un circuit imprimé plus petit, moins de couches pour le même routage et un meilleur rendement de l’assemblage de cartes électroniques compensent souvent une partie du surcoût. Nous adaptons le nombre de cycles à votre conception pour que vous ne payiez pas des couches supplémentaires inutiles.
Les microvias empilés sont-ils fiables lors des cycles thermiques ?
Les microvias empilés peuvent se décoller de leur pastille de connexion selon l’axe Z pendant la refusion et les cycles thermiques, un risque signalé par IPC pour les produits à haute fiabilité. Nous le maîtrisons au moyen de vias remplis de cuivre, d’un nombre de cycles contrôlé, de transitions décalées lorsque l’empilement le permet et d’une protection des vias conforme à IPC-4761. Les circuits imprimés destinés à l’aérospatiale et au médical sont fabriqués et contrôlés selon la classe 3 d’IPC-6012.
Un fabricant implanté en Chine peut-il produire des circuits HDI toutes couches haut de gamme fiables ?
Oui. Des empilements toutes couches avancés, comme 3+N+3, sont produits par des fabricants de circuits imprimés compétents et ont fait leurs preuves sur le terrain ; les acheteurs indiquent atteindre leurs objectifs de qualité et de fiabilité. Ce qu’il faut qualifier, ce n’est pas le pays, mais la capacité de fabrication : demandez quelles structures sont réalisables, quelles sont les limites de remplissage et de rapport d’aspect des microvias, quelle classe IPC est appliquée et un exemple de rapport de traçabilité. En pratique, le véritable risque n’est pas géographique : c’est un procédé qui n’a pas fait ses preuves — écartez tout fabricant de circuits imprimés incapable de présenter ses données de remplissage des microvias ou ses relevés de contrôle, quel que soit son emplacement. Demandez à voir une éprouvette et une coupe avant de vous engager sur une production en série, puis qualifiez la ligne comme vous le feriez pour tout fournisseur de produits à haute fiabilité. PCBark fabrique selon la classe 3 d’IPC-6012 et selon IPC-6016, et propose une analyse DFM complète avant la préparation des outillages.
Combien de couches un circuit imprimé HDI toutes couches peut-il comporter ?
La construction toutes couches s’adapte au nombre de couches, car chaque couche diélectrique possède ses propres microvias. Les conceptions pour appareils mobiles et à grand nombre d’entrées/sorties comportent couramment de 8 à 16 couches ; des nombres plus élevés sont possibles pour les applications spécialisées. La limite pratique de votre conception dépend de la symétrie de l’empilement des couches, des objectifs d’impédance et du nombre de cycles de lamination envisageable, que nous confirmons lors de l’analyse DFM.
Ai-je vraiment besoin du toutes couches, ou une structure 2+N+2 suffit-elle ?
Si la répartition des connexions de votre BGA le plus dense est réalisable en 1+N+1 ou en 2+N+2 dans la limite du nombre de couches, cette structure coûte moins cher et nous vous le dirons. La structure toutes couches n’offre un avantage de prix par rapport aux structures multicouches que lorsque la capacité de connexion par vias est épuisée, qu’une accumulation de composants électroniques à faible espacement limite une structure plus compacte ou que la surface disponible est le facteur limitant. Envoyez-nous l’empilement des couches et les composants au pas le plus fin ; nous vous indiquerons le meilleur prix pour la structure nécessaire au routage de votre conception.
Quelles géométries de microvias et de pistes PCBark propose-t-il pour le HDI toutes couches ?
Les microvias de 100 µm remplis de cuivre présentent un rapport de 0,75 à 1 entre l’espacement des pistes et l’ouverture du via d’interconnexion, conformément à la norme IPC-2226, avec des espacements et des pistes pouvant descendre à environ 75 µm sur une fabrication avancée, selon le matériau utilisé, le nombre de couches et l’épaisseur de la feuille de cuivre. Nous réalisons une analyse DFM « All in One Design » (ADI) pour établir les dimensions atteignables selon votre empilement des couches et les contraintes de votre conception.
De quels éléments avez-vous besoin pour établir un devis pour un circuit imprimé HDI toutes couches ?
Envoyez-nous vos données Gerber ou vos fichiers ODB++, ainsi que votre empilement des couches précisant les éventuelles impédances cibles, la nomenclature complète des composants, votre niveau de conformité IPC (p. ex. classe 3), les quantités souhaitées et les dates auxquelles vous souhaitez recevoir vos pièces finies. Nous utiliserons ensuite nos outils DFM intégrés pour examiner la structure que vous avez conçue, estimer le nombre de cycles, évaluer les matériaux de fabrication, puis vous fournir un devis et un délai adaptés à votre application.
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Soumettez votre structure : nous vous répondrons avec la structure la moins coûteuse compatible avec votre routage HDI, les résultats d’une analyse DFM complète et un devis tenant compte de la classe IPC indiquée. Plus de 16 ans d’expérience en EMS pour accompagner votre projet.
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